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1.TestBencher Pro£ºÓÃÒÔ´Ó¹ÂÁ¢ÓÚÓïÑÔ±í´ïµÄʱÖÓƵÂÊÂß¼ÐÔ±íת»¯³É»¥¶¯Ê½VHDL,Verilog, OpenVera,e, ºÍTestBuilder ²âÊÔ±ê×¼¼°ÏµÍ³×ÜÏß×÷ÓõÄÄ£ÐÍ¡£×ª»¯³ÉµÄ²âÊÔ±ê×¼ÄܸøÓè¸ù¾ÝÄ£Äâ·ÂÕæÏà¶ÔÓ¦µÄ²îÒìµÄ¼¤Æð¿Õ¼äÏòÁ¿£¬±ãÓÚÓÚ²âÊÔ±ê×¼×÷ÓÃ×öΪһ¸ö±»²âÊÔϵͳÈí¼þ×ÔÈ»»·¾³µÄ×ËÊÆÄ£ÐÍÒ»ÇÐÕý³£¹¤×÷ÖС£ TestBencher ProÊÇÒ»¸ö³öÉ«µÄ²âÊÔ¹æÄ£ÐÔFPGA ºÍ ASICÉè¼Æ·½°¸µÄרÓù¤¾ß¡£
2.BugHunter Pro£ºÒ»¿îÓÃÒÔ Verilog£¬ VHDL ºÍ C Ä£ÄâÆ÷µÄͼÐ͵÷½ÚϵͳÈí¼þ¡£BugHunter ÊÊÓÃÈ«²¿¹Ø¼üµÄ HDL Ä£ÄâÆ÷£¬Æä¾ßÌå×÷Óðüº¬£ºµ¥Ò»Á÷³Ìµ÷½Ú¡¢²¨ÐÎÊý¾ÝÐÅÏ¢ÍÆÁ÷¡¢ÏîÄ¿·çÏÕ¹ÜÀíÕâЩ¡£¿ÉÒÔ̽²â³ÌÐòÁ÷³ÌÓëÐÖúÌåϵµÄ»¥¶¯È«¹ý³Ì½ø¶ø·¢¾õ´æÔÚµÄÎÊÌâ¡£
3.VeriLogger Pro£ºVerilogÄ£ÄâÆ÷ÊÖ»úÈí¼þ¡£¸øÓèÒ»¸ö×ÛºÏÐÔÁË´«Í³Ê½VerilogÄ£ÄâÆ÷È«²¿ÌصãµÄÄ£Äâ·ÂÕæ×ÔÈ»»·¾³£¬Ëü¾ß±¸Ç¿¾¢µÄͼÐͲâÊÔʸÁ¿Ëزķ¢ÉúÆ÷¡£VeriLoggerµÄѸËÙÄ£ÐͲâÊÔʹÏû·ÑÕß¿ÉÒÔ¶ÔÉè¼Æ·½°¸ÖеÄÿһ¸öÄ£ÐÍ¿ªÕ¹¡°×Ôµ×ÏòÉÏ¡±µÄ²âÊÔ¡£
4.WaveFormer Pro£ºÓÉ״̬ͼ½âÎöÆ÷¡¢Ä£ÄâÆ÷ºÍ²âÊÔ¿Õ¼äÏòÁ¿ÖÆ×÷Æ÷×é³É¡£ËüΪÉè¼Æ·½°¸¹¤×÷ÈËÔ±¸øÓèÁËÒ»¸öÈںϵÄ×ÔÈ»»·¾³£¬¿ÉÒÔÓÃÓÚ¿ª·¢Éè¼ÆÊý¾ÝºÍ·ÂÕæÄ£Äâ·ÏßµÄ״̬ͼ¡£WaveFormer Pro¿ÉÒÔÓÉSpiceÄ£ÄâÆ÷£¬Mathematica£¬»òMatlabµÈרÓù¤¾ß¼üÈë·ÂÕæÄ£ÄâÊý¾ÝÐÅÏ¢¡£»¹Äܹ»ÔËÓÃWaveFormer Pro ƒÈ²¿ÓÐ×ŵIJ¨ÐκÊýÁ¢¼´×ª»¯³ÉÄ£ÄâÐźţ»»òÊǽ«´Óϵͳ×ÜÏßÉÏ»ñµÃµÄÄ£ÄâÐźÅת»»³ÉÄ£ÄâÐźš£»¹Äܹ»½«Ä£ÄâÐźŲ¨ÐÎÖð¶ÎÏßÐεØת»»³ÉSpiceÄ£ÄâÆ÷µÄ¹¤×÷µçѹÐźÅÔ´¡£
5.SimuTAG£ºÒ»¿î¹¦ÄÜÆëÈ«ºÍ¼´Ê±µØºËʵ³ö FPGAs µÄ²»ÕýÈ·µÄϵͳÈí¼þ¡£¿É¾¹ý½ÏΪFPGA ×÷Óñê×¼·´Ö¤RTL¿îʽ·ÂÕæÄ£Äâ±ê×¼£¬¿ìËÙ·¢¾õÂß¼ÐÔºÍ×ÛºÏÐÔ²»ÕýÈ·¡£
6.PinPort£º¸øÓèÊý¾ÝÓ²¼þÅäÖÃÓëVerilog »òC µÄÐéËƲå¿Ú×ÔÈ»»·¾³¡£
7.DataSheet Pro£ºÊ±¿Ì±íÎļþ¼Ð¹ÜÀíרÓù¤¾ß¡£
8.Timing Diagrammer Pro£ºÊ±¿Ì±íÉè¼Æ¹¤¾ß¡£
9.Gigawave Viewer£º²¨Ðι۲âÆ÷¡£
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